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Ingénieur microélectronique – Expert implementation design for test H/F


Détail de l'offre

Informations générales

Entité de rattachement

Le Commissariat à l'énergie atomique et aux énergies alternatives (CEA) est un organisme public de recherche.

Acteur majeur de la recherche, du développement et de l'innovation, le CEA intervient dans le cadre de ses quatre missions :
. la défense et la sécurité
. l'énergie nucléaire (fission et fusion)
. la recherche technologique pour l'industrie
. la recherche fondamentale (sciences de la matière et sciences de la vie).

Avec ses 16000 salariés -techniciens, ingénieurs, chercheurs, et personnel en soutien à la recherche- le CEA participe à de nombreux projets de collaboration aux côtés de ses partenaires académiques et industriels.  

Référence

2017-3286  

Description de la Direction

CEA Tech est le leader mondial de la recherche technologique. Les équipes d'ingénieurs chercheurs sont mobilisées pour bâtir et transférer à des partenaires industriels des portefeuilles de technologies répondant aux besoins des filières technologiques dans les domaines de l'information, de la communication, de l'énergie et de la santé.

le Leti, un des instituts de CEA Tech concentre son activité sur les micro et nano technologies et leurs applications aux systèmes et composants de communication sans fil, à la biologie et la santé, à l'imagerie, et aux Micro-Nano Systèmes (MNS).

Description de l'unité

Intégré au Leti, le Département d'Architecture, Conception et Logiciel Embarqué a pour mission de créer des technologies :
- De systèmes numériques de calcul intégrés ou embarqués
- De composants intégrés et systèmes d'objets intelligents et communicants sans fil
et de proposer une offre assurant le lien entre technologie et applications, basée sur les plateformes de Conception et Systèmes embarqués, en particulier sur les domaines de l'Internet des Objets, des véhicules autonomes, de l'intelligence artificielle et du HPC.

Dans ce cadre, le laboratoire d‘architecture et de conception de circuits intégrés numériques apporte ses compétences pour la création de blocs de traitement (DSP, réseau-sur-puce, systèmes de cache, blocs de calcul neuromorphique, etc.) et de circuits prototypes allant de structures de caractérisation de technologies avancées (mémoires non volatiles, 3D monolithique) à des prototypes de systèmes sur puce (System-on-chip — SoC) complexes pour des applications de type internet des objets ou calcul intensif. Ces différentes activités nécessite un lien fort avec les équipes du Leti chargées du développement des technologies avancées, de la conception de circuits analogique ou encore de la programmation logicielle des circuits développés.

Description du poste

Domaine

Composants et équipements électroniques

Intitulé de l'offre

Ingénieur microélectronique – Expert implementation design for test H/F

Contrat

CDD

Statut du poste

Cadre

Durée du contrat (en mois)

12 à 18 mois

Description de l'offre

Pour répondre à ses missions, le laboratoire d'intégration silicium des architectures numériques recherche un

INGENIEUR MICROELECTRONIQUE – EXPERT IMPLEMENTATION DESIGN FOR TEST (DFT)

dont les missions seront de contribuer à tout ou partie de la spécification et de l'implémentation de la DFT de circuits numériques complexes :
- Spécification et définition de l'architecture DFT (couverture, définition des domaines, I/O multiplexing, compression, OCC, etc.) ;
- Insertion des éléments DFT (scanchains, BIST, OCC, TAP controllers…) dans les sous-blocs et au top du circuit ;
- Assemblage des éléments DFT au top ;
- Vérification fonctionnelle associée, contraintes d'implémentation associées (contraintes de timing SDC) ;
- Génération et vérification des vecteurs de test.

La complexité des circuits développés viendra de différents facteurs : utilisation de technologies avancées, utilisation de domaines d'horloge et de tension multiples, et taille du circuit pouvant dépasser 100 mm².

Le travail se fera au sein d'une équipe projet d'ingénieurs-chercheurs CEA spécialisés dans la conception de circuits numériques, et en relation avec des partenaires industriels et/ou académiques, en France ou en Europe en particulier. Des déplacements et missions sont possibles pour des salons et conférences ou chez nos partenaires.

Les profils et compétences rencontrées étant variés, une ouverture d'esprit et la prise d'initiatives sont indispensables pour mener à bien les projets, et pour aller chercher l'innovation dans la complémentarité des personnes allouées aux projets.

Les résultats obtenus et l'activité inventive devront prioritairement faire l'objet d'une analyse de propriété intellectuelle en vue de leur protection ou exploitation, ainsi que, le cas échéant, de publications scientifiques.

Profil du candidat

Formation :
Ingénieur de formation ayant une expérience significative en implémentation de la DFT de circuits numériques.
Une bonne compréhension des problématiques de couverture de test et de rendement associé est nécessaire au bon déroulement de la mission.

Compétences indispensables :
- Architecture DFT dans les SoC ;
- Protocoles de pilotage de la DFT (JTAG, IEEE1500…) et IP associées (TAP controller, etc.) ;
- Outils CAO dédiés à la DFT (insertion scan, BIST, OCC, compression ; génération des vecteurs de test).

Compétences fortement souhaitées :
- Outils de simulation pour la vérification fonctionnelle ;
- Contraintes de synthèse (SDC) ;
- Outils d'équivalence checking ;
- Bonne connaissance du flot de conception numérique complet.

Localisation du poste

Site

Grenoble

Localisation du poste

France, Rhone-Alpes

Lieu

17 Avenue des Martyrs, • 38054 Grenoble, France

Critères candidat

Formation recommandée

Diplôme d'ingénieur en électronique

Demandeur

Disponibilité du poste

01/09/2017


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